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高速缓冲存储器（Cache）的功能是提高CPU数据传入传出的速率，突破所谓的（），即CPU与存储系统之间数据传送带宽限制

题目
单选题
高速缓冲存储器（Cache）的功能是提高CPU数据传入传出的速率，突破所谓的（），即CPU与存储系统之间数据传送带宽限制。
A

冯•诺依曼瓶颈

B

电光转换瓶颈

C

光电转换瓶颈

D

网络传输瓶颈

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第1题：

计算机高速缓冲存储器的主要作用是解决之间交换数据的速度瓶颈问题()。

A、CPU与输入输出设备

B、CPU与硬盘

C、CPU与内存

D、CPU与键盘


参考答案：C

第2题：

CPU中的高速缓冲存储器Cache,可以长期存放数据。()

此题为判断题(对，错)。


正确答案：×

第3题：

●位于CPU与主存之间的高速缓冲存储器Cache用于存放部分主存数据的拷贝，主存地址与Cache地址之间的转换工作由(1)完成。

(1)A．硬件

B．软件

C．用户

D．程序员


正确答案：A

第4题：

高速缓冲存储器Cache是位于CPU和主存DRAM之间规模或容量较小但速度很快的存储器。下面是关于Cache的叙述，其中错误的是( )。

A．PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，即，达到了即降低成本又提高系统性能的目的

B．CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态

C．CPU访问CaChe“未命中”时，信息需从主存(DRAM)传送到CPU，这时CPU要插入等待状态

D．L1 Cache的工作频率和CPU的工作频率相等，L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率


正确答案：D

第5题：

答案及其解析——位于CPU与主存之间的高速缓冲存储器(Cache)用于存放部分主存数据的拷贝，主存地址与Cache地址之间的转换工作由_____完成。


答案:A
本题考查高速缓冲存储器(Cache)的工作特点。 提供“高速缓存”的目的是为了让数据存取的速度适应CPU的处理速度，其基于的原理是内存中“程序执行与数据访问的局域性行为”，即一定程序执行时间和空间内，被访问的代码集中于一部分。为了充分发挥高速缓存的作用，不仅依靠“暂存刚刚访问过的数据”，还要使用硬件实现的指令预测与数据预取技术，即尽可能把将要使用的数据预先从内存中取到高速缓存中。 一般而言，主存使用DRAM技术，而Cache使用昂贵但较快速的SRAM技术。 目前微计算机上使用的AMD或Intel微处理器都在芯片内部集成了大小不等的数据高速缓存和指令高速缓存，通称为L1高速缓存(L1 Cache，即第一级片上高速缓冲存储器)；而比L1容量更大的L2高速缓存曾经被放在CPU外部(主板或者CPU接口卡上)，但是现在已经成为CPU内部的标准组件；更昂贵的顶级家用和工作站CPU甚至会配备比L2高速缓存还要大的L3高速缓存。

 

第6题：

中断控制方式的优点是()。

A、提高CPU的利用率

B、提高CPU与外设的数据传送精度

C、提高CPU与外设的数据传送速度

D、减少外设的等待时间


参考答案：A

第7题：

高速缓冲存储器 Cache是位于CPU和主存DRAM之间规模或容量较小但速度很快的存储器。下面是关于Cache的叙述，其中错误的是( )。

A．PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，即达到了即降低成本又提高系统性能的目的

B．CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态

C．CPU访问CaChe“未命中”时，信息需从主存(DRAM)传送到CPU，这时CPU要插入等待状态

D．L1 Cache的工作频率和CPU的工作频率相等，L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率


正确答案：D

第8题：

计算机系统为改善CPU与处理器之间的速度匹配问题,在CPU和主存储器之间加入一个高速、小容量的缓冲存储器Cache,构成Cache—主存储器的存储系统。()

此题为判断题(对，错)。


参考答案：错误

第9题：

在cpu内外常需设置多级高速缓存cache,主要目的是( )。

A、扩大主存的存储容量

B、提高cpu访问主存数据或指令的效率

C、扩大存储系统的存量

D、提高cpu访问内外存储器的速度


正确答案：D

第10题：

在cpu内外常需设置多级高速缓存cache，主要目的是（ ）。

A.扩大主存的存储容量
B.提高cpu访问主存数据或指令的效率
C.扩大存储系统的容量
D.提高cpu访问外存储器的速度

答案：B
解析：
Cache存放的内容是主存内容的一部分副本，其目的是提高cpu访问主存数据或指令的效率。

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